Domaine scientifique de la Doua
Bâtiment Paul Dirac
4, Rue Enrico Fermi
69622 Villeurbanne Cedex
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Direction : +33 (0) 4 72 44 84 57
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Electronique d’aquisition R&D

Cette R&D propose une version améliorée de la carte processeur mezzanine Opéra.

  • Interface Gigabit Ethernet (VHDL IP Gigabit MAC)
  • Pas de software TCP/IP (transfert direct à travers l’interface MAC)
  • Processeur NIOS configurable dans un FPGA ALTERA
  • Réseau synchronisé avec le protocole PTP (IEEE 1588)